THIẾT KẾ, MÔ PHỎNG BỘ LỌC NHIỄU TÍN HIỆU ÐIỆN TIM DÙNG MATLAB VÀ CHUYỂN MÃ VHDL

Xây dựng một bộ lọc số trên nền tảng FPGA để lọc nhiễu tín hiệu điện tim ECG nhằm đem lại tín hiệu xác thực nhằm hỗ trợ tốt hơn cho việc khám chữa bệnh. Trong đó, FPGA được xem như là phần cứng với chức năng thực thi bộ lọc nhiễu cho tín hiệu điện tim, còn Matlab được sử dụng như một công cụ để thiết kế và mô phỏng bộ lọc nhằm đánh giá khả năng thực hiện trong thực tế.
Bạn đang xem trang mẫu tài liệu này.